A.網(wǎng)絡(luò)電阻精度
B.模擬開(kāi)關(guān)導(dǎo)通電阻
C.電流建立時(shí)間
D.加法器
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A.RAM
B.COMP
C.ROM
D.MUX
A.代碼轉(zhuǎn)換
B.邏輯函數(shù)
C.乘法運(yùn)算
D.計(jì)數(shù)器
A.EPROM
B.E2PROM
C.PLA
D.PAL
A.不
B.紫外線
C.電
D.高壓電
A.不
B.電
C.紫外線
D.融斷器
A.00
B.01
C.10
D.無(wú)法確定
最新試題
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
一個(gè)16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個(gè)。
以下代碼中為無(wú)權(quán)碼的為（）。
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
TTL與非門閾值電壓UT的典型值是（）